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摘 要:針對(duì)高精度位移傳感器對(duì)高速位移測量算法的運(yùn)行速度、可移植性及降低研發(fā)成本的需求,提出一種基于高層次綜合(high level synthesis, HLS)技術(shù)的高精度測量算法的硬件加速設(shè)計(jì)方法。使用HLS技術(shù)實(shí)現(xiàn)C++語言到Verilog語言的綜合,針對(duì)高精度位移測量算法設(shè)計(jì)策略,利用HLS技術(shù)中的流水化和數(shù)組重構(gòu)等優(yōu)化技術(shù)進(jìn)行硬件加速,并將其封裝為知識(shí)產(chǎn)權(quán)(intellectual property, IP)核,提高算法的可移植性。(剩余23300字)
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基于HLS的高精度位移測量算法的硬件加速設(shè)計(jì)
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