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摘要: 為解決卷積神經(jīng)網(wǎng)絡(luò)(CNN)高效部署的挑戰(zhàn),提出一種基于軟硬件協(xié)同設(shè)計(jì)的異構(gòu)CNN加速器,并在YOLOv4-tiny模型上進(jìn)行驗(yàn)證。搭建基于高級(jí)精簡(jiǎn)指令集機(jī)器(ARM)處理器與現(xiàn)場(chǎng)可編程門陣列(FGPA)的異構(gòu)系統(tǒng)。通過高層次綜合(HLS)將可并行執(zhí)行的計(jì)算單元映射為FPGA端寄存器傳輸級(jí)(RTL)知識(shí)產(chǎn)權(quán)(IP);ARM處理器控制系統(tǒng)的協(xié)同工作與IP核的調(diào)度,最終實(shí)現(xiàn)前向推理加速。(剩余13973字)
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軟硬件協(xié)同設(shè)計(jì)的異構(gòu)CNN加速器
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